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那个我懂了,我用verilog写了一个,但我记得m序列的初始状态的第一位好像是必须是1开头的,是吗
如题所述
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推荐答案 2010-12-14
噢 这个可不一定啊,它伪随机序列啊,大哥 你倒是把我的回答都给采纳了吧来自:求助得到的回答
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初始
化模块 begin a=0;//a存放M序列上一码元的值 end m1 m1(.gclock(clk),.EN(EN),.M_code(M),.clk(clk_M));//产生M序列 mydds dds_ask(.gclock(clk),.clr(cl...
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答:
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M序列
编码 M_buf[4] <= M_buf[0]^M_buf[3];M_buf[0] <= M_buf[1];M_buf[1] <= M_buf[2];M_buf[2] <= M_buf[3];M_buf[3] <= M_buf[4];end end ...
verilog
如何生成
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答:
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